本次实验学习记录主题为“FIFO_IP核实现算术求和”，主要内容是上位机通过串口向FPGA发送一定规格的数字矩阵，FPGA对矩阵处理，按规定逻辑实现求和运算，将结果返回串口转发至上位机。
要求：调用PLL—IP核，50Mhz晶振输入，输出四路时钟不同信号：100Mhz，25Mhz，50Mhz(90°相位)，50Mhz（20%占空比）。 芯片型号：cyclone Ⅳ EP4CE10F17C8 平台工具：Quartus II 15.0 (64-bit)、Modelsim SE-64 ...
文章摘要：借助于QuartusII PLL_IP核产生一个任意频率被测时钟信号，设计一个等精度测量模块，通过其处理后，再数码管上显示出六位的测量频率数值，验证测量的准确度。 关键词：Verilog HDL；等精度频率测量；数码管；PLL_IP核 最终框图： 频率计，即频率计数器，专用于测量被测信号频
quarkus是如何支持虚拟线程的呢？今天咱们一起来阅读quarkus源码，学习从框架开发视角去添加新特性，除了开阔眼界，也为为自己的设计能力提升增加有效的参考信息
《quarkus实战》系列开篇，介绍什么是quarkus，为后序深入学习做准备
创建一个quarkus应用，修改功能代码，再编译构建，部署运行，今天一起把这些过程全部操作一遍
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将本地的改动极速同步到远程服务端，并自动生效，掌握此技能，开发调试会更高效
quarkus的maven插件非常重要，管理和构建工程时都离不开，本篇就来一起了解和掌握它
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《quarkus依赖注入》系列聚焦quarkus框架下bean的创建、使用、配置等场景的知识点，本文是系列的开篇，介绍CDI，实战创建bean
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注入点的类型，如果有多个bean都是该类型的实现，应该如何选择呢？本篇尝试通过多种注解来选择
除了前文的配置项、profile等手段，在注入点选择bean的时候，还有很多种灵活的选择方式，一起来掌握吧
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quarkus框架下，进程内同步、异步发布和消费事件的操作
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